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实 验 报 告
课程名称： 1504010320 实验项目： 2-4地址译码器实验 姓 名： 吴雅惠 专 业： 计算机科学与技术 班 级： 3 学 号： 1504010320
计算机科学与技术学院
实验教学中心
2016 年 6 月 21 日
一、. 实验目的：掌握译码器设计方法和原理，加深对中大规模集成电路的理解。
设计一个具有使能端的2—4 译码器，并用Verlog HDL条件运算符描述。
译码器逻辑功能描述：
可分别用逻辑图、函数式和真值表来描述，这里用函数式说明:。
三、实验步骤: ⑴在D盘上建一个子目录。
⑵打开Quartus Ⅱ后，点击fils→New Projcct Wizard对话框，建立工程名。
⑶选择仿真器件，器件类型选择FLEX10K，具体芯片选择EPF10K10tc144-4
⑷点击fils→New ，双击Block Diagram/Schematic File建立图形文件并编译。
⑸点击fils→New ，双击Verilog HDL File建立文本文件并编译。
⑹点击fils→New ，双击Vector Waveform File建立波形文件，分析仿真波形。
⑺选择Assignments →Pins选择绑定对应元件管脚，点击Start下载到芯片。
四、实验结果（要求抓图）
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哈尔滨理工大学计算机科学与技术学院实验教学中心 实验报告
哈尔滨理工大学计算机科学与技术学院实验教学中心 实验报告
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