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第五章 触发器 * 章目录 第5章 触发器FF（Flip Flop） 5.1 概述 一、触发器概念 有 一个或多个输入，两个互反的输出（Q和Q），具有两个稳定状态，在外界输入信号作用下状态能改变；能存储一位0或1数据的基本单元电路（有记忆功能）。 节目录 标题区 一个或多个输入 FF Q Q 节目录 标题区 从“1”态转变为“0”态或者相反称为FF的翻转 通常用Q端的数值代表触发器的状态。 例如；Q=0为“0”态，Q=1为“1”态 二、触发器的分类 1.按触发是否受控于时钟脉冲CP (Clock Pulse ) (1) 异步触发器 (2) 同步触发器 （不受CP控制，满足条件则工作） （受CP控制，与其同步工作） ①钟控电位触发器 （电位触发） ②主从触发器 （主从触发或脉冲触发） ③边沿触发器 （边沿触发） 节目录 标题区 2. 按实现的逻辑功能 (3) JKFF (1) SRFF (2) DFF (4) TFF (5) T′FF 节目录 标题区 1.电路构成 一、与非门构成的基本SRFF 5.2 基本SRFF(SDRDFF) (a) 逻辑电路 Q SD G1 G2 Q RD SD、RD (输入端)； SD：直接置1端，使Q=1； RD：直接置0端，使Q=0; 低电平有效。 节目录 标题区 图 5.2.1 与非门构成的基本SRFF Q Q SD RD (b) 曾用符号 (c) 国标符号 Q Q SD RD R S 节目录 标题区 2.逻辑功能 1.状态：（1).现态(当前状态)：接收信号前的 状态，用Qn表示； （2).次态(下一状态)：接收信号后的状态，用Qn+1表示。 2.逻辑功能分析 要求触发脉冲的持续时间 tw 2tpd 节目录 标题区 3.逻辑功能的表示方法 (1)状态转移表（真值表） (2)功能表：状态转移表简化形式 节目录 标题区 (3)次态方程 （次态是关于现态和激励的函数） 0 1 0 0 1 1 1 × × 0 10 11 01 00 SD RDQn 图5.2.2 求次态方程的卡诺图 （由真值表得到） Qn+1 = SD + RDQn SD + RD = 1 (约束条件： 、 不能同时为 0,即该两个信号不能同时有效) (4)状态转移图 (5)激励表（产生状态转移的输入信号条件） (6)波形图（时序图） 图 5.2.3 与非门基本触发器的状态转移图 0 SD=1 RD=? 1 SD=? RD=1 SD=0 RD=1 SD=1 RD=0 节目录 标题区 二、或非门构成的基本SRFF (a) 逻辑图 Q RD ≥1 G1 ≥1 G2 Q SD 图 5.2.5 或非门基本SRFF Q Q SD RD (b) 曾用符号 (c) 国标符号 Q Q SD RD R S 1.电路构成 节目录 标题区 2.逻辑功能的表示方法 (1)状态转移表（真值表） 表 5.2.4 或非门基本触发器的状态转移表 节目录 标题区 (2)次态方程 Qn+1 = SD + RDQn SD· RD = 0 (约束条件:SD和RD不能同时为1) 节目录 标题区 特点：1.激励（数据输入）决定触发器转移到何种状态。 5.3钟控电位触发器（同步触发器） 2 .时钟（触发输入或控制输入）决定触发器状态何时转移。 一、钟控SRFF(SR锁存器) 1.电路构成： 在基本触发器的基础上增加“控制门电路” 节目录 标题区 图 5.3.1 钟控SRFF (a) 逻辑图 (b) 曾用符号 (c) 国标符号 节目录 标题区 3.逻辑功能 (1)次态方程 CP=0时，Qn+1=Qn Qn+1=S+RQn SR=0 CP=1时， 2.钟控原理 图 5.3.2 时钟脉冲CP的波形 节目录 标题区 T 考虑到tpd, Q在CP↑发生后延迟两个tpd由低变高； 延迟3个tpd由高变低。 (2)功能表和激励表 表 5.3.1 钟控SRFF功能表 节目录 标题区 表 5.3.2 钟控SRFF激励表 节目录 标题区 (3)理想波形图 （未考虑延迟时间tpd） 节目录 标题区 Q Q CP × R × S 二、钟控DFF(透明式D锁存器) 1.电路构成 (a) 逻辑图 (b) 曾用符号 (c) 国际符号 节目录 标题区 CP=0时，Qn+1=Qn （次态=现态） CP=1时，Qn+1=D （次态Q=输入端数据） 2.逻辑功能(能存储一位二进制数据） (1)次态方程 (2)功能表和激励表 表 5.3.3 钟控DFF功能表 节目录 标题区 表 5.3.4