低功耗异步ldpc解码器运算通路设计 low power design of asynchronous datapath for ldpc decoder.pdfVIP

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2017-08-13 发布于上海
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低功耗异步ldpc解码器运算通路设计 low power design of asynchronous datapath for ldpc decoder.pdf

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低功耗异步ldpc解码器运算通路设计 low power design of asynchronous datapath for ldpc decoder

第4期电子学报 V01．4lNo．4 2013年4月 ACTAEI五(】RONICASINICA Apr． 2013 低功耗异步LDPC解码器运算通路设计姜小波，叶德盛，吴文涛，徐向民 (华南理工大学电子与信息学院，广东广州510641) 摘要：本文设计了异步LDPC解码器运算通路，利用异步电路减少信号到达时间不一致引起的毛刺和时钟引起的功耗．利用输入数据的统计特性设计了运算通路中的主要运算单元，减少了冗余运算．本文还实现了同步运算通 CMOS工艺下实现相同的功能．仿真结路和基于门控时钟的运算通路作为比较．三种设计采用相近的架构，在0．18tan 果表明，提出的异步设计功耗最小，相比于同步设计和基于门控时钟设计，分别节省了42．O％和32．6％的功耗．虽然性能稍逊于同步设计，但优于门控时钟设计．其中，同步设计的延时是1．09ns，基于门控时钟的设计延时是1．61ns，而异步设计则是1．20ns．关键词：LDPC码；异步设计；低功耗；比较器；加法器中图分类号：TN914文献标识码： A 文章编号：0372．2112(2013)04-0685．05 电子学报URL：http：／／www．ejoumal．org．cn1)OI：t0．3969／j．issn．0372—2112．2013．04．010 LowPower of forLDPCDecoder DesignAsynchronousDatapath JL、t4G Xiao—bo，YE Wen-tao，XU De—sheng，WU Xiang-min (SchoolElectronand China of InformationEngine耐ng，SotahUniversityof Abstract： ofLDPCdecoderis inthis andredundant arede— Asynchronousdatapath proposedpaper．Glitches computations data creased treeis handshakecontrol of statisticalcharac— design．Clock advantages byasynchronous replacedby units．Taking input arithmeticelementsinthe are of and teristic，key datapathproposed．Twotypesdatapathsincludingsynchronousdesignclock-gating arealso ascontrasts．Three similararchitectureandrealizethesamefunction0．1灿nCMOS design implemented designsexploit by