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verilog教程范例(北的京至芯科技FPGA培训)
Verilog 设计举例;设计示例一用门级结构描述D触发器 ;设计示例一;用户定义的原始元件;用户定义的原始元件; 设计示例二由已设计的模块来构成高一级的模块; 设计示例二; 设计示例三编写测试模块通过仿真检查设计正确与否 ; 设计示例三 (续); 设计示例三 (续);设计示例三 (续);设计示例四 带异步复位端的 D 触发器;设计示例四(续)用D触发器构成T触发器;设计示例四(续)用四个T触发器组成一个进位计数器;设计示例四(续)用激励信号对进位计数器进行测试;设计示例四(续)用激励信号对进位计数器进行测试;设计示例四(续)用激励信号对进位计数器进行测试;设计示例五用一位全加器组成四位全加器;设计示例五(续) 用一位全加器组成四位全加器;设计示例五(续) 用四位全加器的测试;设计示例五(续) 四???全加器的另一种描述;综合的一般原则;设计示例六:指令译码电路的设计实例(利用电平敏感的always块来设计组合逻辑);设计示例六:指令译码电路的设计实例(利用电平敏感的always块来设计组合逻辑);设计示例六:指令译码电路的测试;设计示范七:状态机和电路动作的控制;设计示范七:状态机和电路动作的控制;设计示范七:状态机和电路动作的控制;设计示范七:状态机和电路动作的控制;设计示范七:状态机和电路动作的控制;设计示范七:状态机和电路动作的控制;设计示范七:状态机和电路动作的控制;设计示范七:状态机和电路动作的控制;设计示范七:状态机和电路动作的控制;设计示范七:状态机和电路动作的控制;设计示范七:状态机和电路动作的控制:测试信号源的行为模块;设计示范七:状态机和电路动作的控制:测试信号源的行为模块;设计示范七:状态机和电路动作的控制:测试顶层模块;设计示范七:波形图
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