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LVDS技术原理和设计简介

LVDS 技术原理和设计简介 摘 要: 介绍了 LVDS (低电压差分信号)技术的原理和应用, 并讨论了在单板和系统设计中应用 LVDS 时的布线技巧。 关键词: LVDS PCB 设计 1 LVDS介绍 LVDS(Low Voltage Differential Signaling)是一种低摆幅的差分信号技术,它 使得信号能在差分 PCB 线对或平衡电缆上以几百 Mbps 的速率传输,其低压幅和低电流 驱动输出实现 了低噪声和低功耗。 几十年 来,5V 供电的使用简化了不 同技术和厂商 逻辑电路之间的接口。然 而,随着集成 电路的发展和对更高数据 速率的要求, 低压供电成为急需。降低供 电电压不仅减 少了高密度集成电路的功 率消耗,而且 减少了芯片内部的散热,有 助于提高集成 度。 减少供电 电压和逻辑电压摆幅的一 个极好例子是低压差分信号(LVDS)。LVDS 物理接口使用 1.2V 偏置提供 400mV 摆幅的 信号 (使用差分信号的原因是噪声以共模的方式在一对差分线上耦合出现,并在接收器 中相减从而可消除噪声)。LVDS 驱动和接收器不依赖于特定的供电电压,因此它很容易 迁移到低压供电的系统中去,而性能不变。作为比较,ECL 和 PECL 技术依赖于供电电压, ECL 要求负的供电电压,PECL 参考正的供电电压总线上电压值(Vcc)而定。而GLVDS 是一种发展中的标准尚未确定的新技术,使用 500mV 的供电电压可提供 250mV 的信号摆 幅。不同低压逻辑信号的差分电压摆幅示于图1。 LVDS 在两个标准中定义。IEEE P1596.3(1996 年3月通过),主要面向 SCI(Scalable Coherent Interface),定义了 LVDS 的电特性,还定义了 SCI 协议中包交换时的编码; ANSI/EIA/EIA-644(1995 年 11 月通过),主要定义了 LVDS 的电特性,并建议了 655Mbps 的最大速率和 1.823Gbps 的无失真媒质上的理论极限速率。在两个标准中都指定了与物 理媒质无关的特性,这意味着只要媒质在指定的噪声边缘和歪斜容忍范围内发送信号到 接收器,接口都能正常工作。 LVDS 具有许多优点:①终端适配容易;②功耗低;③具 有 fail-safe 特性确保可靠性;④低成本;⑤高速传送。这些特性使得 LVDS 在计算机、 通信设备、消费电子等方面得到了广泛应用。 图2给出了典型的 LVDS 接口,这是一种单工方式,必要时也可使用半双工、多点 配置方式,但一般在噪声较小、距离较短的情况下才适用。每个点到点连接的差分对由 一个驱动器、互连器和接收器组成。驱动器和接收器主要完成 TTL 信号和 LVDS 信号之 间的转换。互连器包含电缆、PCB 上差分导线对以及匹配电阻。LVDS驱动器由一个驱动 差分线对的电流源组成 通常电流为 3.5mA),LVDS 接收器具有很高的输入阻抗,因此 驱动器输出的电流大部分都流过 100Ω 的匹配电阻,并在接收器的输入端产生大约 350mA 的电压。当驱动器翻转时,它改变流经电阻的电流方向,因此产生有效的逻辑 ″1″和逻辑″0″状态。低摆幅驱动信号实现了高速操作并减小了功率消耗,差分信号 提供了适当噪声边缘和功率消耗大幅减少的低压摆幅。功率的大幅降低允许在单个集成 电路上

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