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电子技术课程设计报告书 课题名称 电子秒表设计 姓 名 学 号 院、系、部 电子与电气工程学院 专 业 电子信息工程 指导教师 2012年 06 月20 日 电子秒表设计 一、 设计目的 （1）学习数字电路中基本集成双D触发器、时钟发生器及计数、译码显示等单元电路的综合应用。方法。 （3）设计时钟发生器电路。 （4）设计计数及译码显示电路。 三、技术要求：要求设计一个数字表，用于短时间测量，适用于计时使用 （1）计时范围：0～59秒 （2）显示分辨率为1s。 （3）用按钮开关控制工作状态，即：暂停、清零。 （4）本身带有，工作时指示灯亮。 四、 设计过程 方案论证 电路设计 1、脉冲发生器 脉冲发生器是数字钟的核心部分，它的精度和稳定度决定了数字钟的质量，通常用晶体振荡器产生标准频率信号经过整形、分频获得1Hz的秒脉冲。石英晶体振荡器的特点是振荡频率准确、电路结构简单、频率易调整。如晶振为32768 Hz，通过15次二分频后可获得1Hz的脉冲输出，电路图如图2-1所示。 2、秒计数译码电路 秒计数器为M=60的计数器，即显示00～59，采用中规模集成电路双十进制计数器至少需要2片，因为10 M 100。它的个位为十进制，十位为六进制。本电路采用两片74LS161实现。当个位计数至1010时，通过 74LS00 二输入与非门连至清零端达到清零，当达到0000时，产生上升脉冲送给十位。十位计 数至0110时清零 电子秒表原理图电路如图所示 品名 规格型号 技术要求 每组数量 通用板 10×15（cm2） 10×15（cm2） 1 共阴极数码管 BS201A/0.5英寸 单个 2 集成显示译码器 CD4511 CD4511 2 集成14位计数器 CD4060 CD4060 1 集成双BCD计数器 CD4518 CD4518 1 集成双D触发器 74HC74 74HC74 1 集成逻辑与非门 74HC00 74HC00 1 电阻器 RJ-22MΩ-1/4W 1/4W 1 电阻器 RJ-200kΩ-1/4W 1/4W 1 电阻器 RJ-300Ω-1/4W 1/4W 14 电容器 CC1-30pF（瓷片） 瓷片 2 电容器 CC1-0.01μF（瓷片） 瓷片 1 石英晶体振荡器 32.768kHz 32.768kHz 1 小型按键单开关 8×8mm 8×8mm 1 集成电路插座 16PIN 16PIN 3 集成电路插座 14PIN 14PIN 2 集成电路插座 8PIN 8PIN(两个8PIN作为16PIN) 2 焊锡（小卷） 小卷 导线单芯 单芯 器材选择 芯片管脚排列及用途 （1） 集成双D触发器 　74HC74是一款高速CMOS器件，74HC74引脚兼容低功耗肖特基TTL（LSTTL）系列。74HC74遵循JEDEC标准no.7A74HC74是双路D 型上升沿触发器 ，带独立的数据（D）输入、时钟 （CP）输入、设置（SD）和复位（RD）输入、以及互补的Q和Q输出。设置和复位为异步低电平有效，且不依赖于时钟输入。74HC74数据输入口的信息在时钟脉冲的上升沿传输到Q口。为了获得预想中的结果，D输入必须在时钟脉冲上升沿来临之前，保持稳定一段就绪时间。74HC74时钟输入的施密特触发功能使得电路对于缓慢的脉冲上升和下降具备更高的容差性。74HC74 特性 工作电压范围：2.0～6.0 V 对称输出阻抗 高抗扰 低功耗 ESD保护 CD4060是4000系列CMOS器件中的一种，是14位二进制计数器。它内部有两反相器，外接两个电阻及一个电容就可组成振荡器，作为时钟发生器。输入时钟脉冲时（下降沿），输出端输出记数脉冲。它有一个复位端（Reset），当复位端为高电平时．所有输出端都是低电平， CD4060为16管脚DIP封装，各管脚排列如图3所示。其中Clock in是时钟脉冲输入，Clock out1及Clockout2是时钟脉冲输出（相位差180°，Reset是复位输入端（高电平有效）．Q4～Q14是二进制记数脉冲输出端，Vdd为电源正端（3～18V）．Vss为电源负端。CD4518，该IC是一种同步加计数器，在一个封装中含有两个可互换二/十进制计数器，其功能引脚分别为1～7和9～{15}。该计数器是单路系列脉冲输入（1脚或2脚；9脚或10脚），4路BCD码信号输出（3脚～6脚；{11}