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《数字逻辑系统设计》课程教学大纲
一、《数字逻辑系统设计》课程说明
（一）课程代码（二）课程英文名称：Digital Logic System Design
（三）开课对象：电子信息工程（本科）
（四）课程性质：
数字逻辑系统设计是电子信息学科的一门专业教育课。本课程的目的在于运用硬件描述语言建模、仿真和综合技术设计高性能数字信号处理电路电路、模拟电子技术、数字电子技术、电工电子学第章 概述第二章 第章第章 第章 VHDL第章 第章 VHDL结构 第章 第章 2 0 2 期中考试及试题讲解 0-4 0 0-4 总复习 2 0 2 合 计 48-68 20-30 68-98 （八）教学方式 以多媒体教学手段为主要形式的课堂教学。
（九）考核方式和成绩记载说明
考核方式为考试。严格考核学生出勤情况，达到学籍管理规定的旷课量取消考试资格。综合成绩根据平时成绩和期末成绩评定，平时成绩占20% ，实验成绩占20%，期末成绩占60% 。
二 、讲授大纲与各章的基本要求
第一章 本章要达到的目的主要是让学生了解EDA技术的发展概况、实现目标及发展趋势，了解VHDL硬件描述语言、VHDL综合及VHDL自顶向下的设计方法。
?考核要求：
1.1 电子设计自动化技术及其发展 （了解）
1.2 电子设计自动化应用对象 （了解）
1.3 VHDL （了解）
1.4 EDA的优势 （了解）
1.5 面向FPGA的开发流程 （领会）
1.6 QuartuscⅡ概述 （领会）
1.7 IP核 （了解）
1.8 EDA技术的发展趋势（了解）
第二章
教学要点：本章要达到的目的主要是让学生简单了解FPGA/CPLD产品，FPGA/CPLD的结构与工作原理，FPGA/CPLD的编程与配置。?考核要求：
2.1 PLD概述（了解）
2.2 低密度PLD可编程原理（了解）
2.3 CPLD的结构与可编程原理（领会）
2.4 FPGA的结构与工作原理 （领会）
2.5 硬件测试技术（了解）
2.6 FPGA／CPLD产品概述（了解）
2.7 编程与配置（了解）
第三章
教学要点：本章要达到的目的主要是让学生
3.1 VHDL基本语法
3.2 时序电路描述
3.3 全加器的VHDL描述
3.4 计数器设计
3.5 一般计数器的VHDL设计方法
3.6 数据对象
3.7 IF语句概述
3.8 进程语句归纳
3.9 并行赋值语句概述
3.10 双向和三态电路信号赋值
3.11 仿真延时
考核要求：
3.1 VHDL基本语法（应用）
3.2 时序电路描述（应用）
3.3 全加器的VHDL描述（应用）
3.4 计数器设计（应用）
3.5 一般计数器的VHDL设计方法（应用）
3.6 数据对象 （应用）
3.7 IF语句概述（应用）
3.8 进程语句归纳（应用）
3.9 并行赋值语句概述（应用）
3.10 双向和三态电路信号赋值 （应用）
3.11 仿真延时（领会）
第四章
教学要点：本章要达到的目的主要是通过具体实例让学生掌握原理图输入设计方法，学会CPLD环境开发软件QuartuscII的。
4.1 QuartuscⅡ设计流程
4.2 嵌入式逻辑分析仪
4.3 编辑SignalTapcⅡ的触发信号
4.4 LPM_ROM宏模块应用
4.5 In-System Memory content editor应用
4.6 LPMcRAM／FIFO的定制与应用
4.7 LPM嵌入式锁相环调用
4.8 IP核NCO使用方法
4.9 原理图设计方法
4.10 流水线乘法器的混合输入设计实验系统组成介绍?
考核要求：
4.1 QuartuscⅡ设计流程（应用）
4.2 嵌入式逻辑分析仪（应用）
4.3 编辑SignalTapcⅡ的触发信号 （应用）
4.4 LPM_ROM宏模块应用 （应用）
4.5 In-System Memory content editor应用（应用）
4.6 LPMcRAM／FIFO的定制与应用（应用）
4.7 LPM嵌入式锁相环调用（应用）
4.8 IP核NCO使用方法（应用）
4.9 原理图设计方法 （应用）
4.10 流水线乘法器的混合输入设计（应用）
实验系统组成介绍?（应用）
第五章
教学要点：本章要达到的目的主要是让学生初步掌握用。
5.1 状态机设计相关语句
5.2 Moore状态机
5.3 Mealy状态机
5.4 状态编码
5.5 非法状态处理
?考核要求：
5.1 状态机设计相关语句（应用）
5.2 Moore状态机 （应用）
5.3 Mealy状态机 （应用）
5.4 状态编码 （了解）
5.5 非法状态处理（应用）
第章
教学要点：本章要达到的目的主要是
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