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第11章 组合逻辑电路 11.1 组合逻辑电路的分析和设计11.1.1 组合逻辑电路的分析 11.1.1 组合逻辑电路的分析 11.1.1 组合逻辑电路的分析 11.1.1 组合逻辑电路的分析 11.1.1 组合逻辑电路的分析 11.1.1 组合逻辑电路的分析 11.1.1 组合逻辑电路的设计 11.1.1 组合逻辑电路的设计 11.1.1 组合逻辑电路的设计 11.1.1 组合逻辑电路的设计 11.1.1 组合逻辑电路的设计 11.1.1 组合逻辑电路的设计 11.2 加法器11.2.1 半加器 11.2.1 半加器 11.2.2 全加器 11.2.2 全加器 11.2.2 全加器 11.2.3 多位数加法器 11.2.3 多位数加法器 11.2.3 多位数加法器 11.3 编码器 11.3.1 二进制编码器 11.3.1 二进制编码器 11.3.1 二进制编码器 11.3.1 二进制编码器 11.3.2 二-十进制优先编码器 11.3.2 二-十进制优先编码器 11.4 译码器和数字显示电路 11.4.1 二进制译码器 11.4.1 二进制译码器 74LS138译码器的真值表 11.4.1 二进制译码器 11.4.2 数字显示译码器 11.4.2 数字显示译码器 11.4.2 数字显示译码器 11.4.2 数字显示译码器 11.4.2 数字显示译码器 11.5 数据分配器和数据选择器 11.5.1 数据分配器 11.5.2 数据选择器 11.5.2 数据选择器 74LS138集成译码器逻辑图 0 1 1 1 1 1 1 1 1 1 1 0 1 1 0 1 1 1 1 1 1 0 1 1 0 1 1 1 0 1 1 1 1 1 1 0 1 0 1 1 1 1 0 1 1 1 1 0 0 1 0 1 1 1 1 1 0 1 1 1 1 1 0 0 1 1 1 1 1 1 0 1 1 0 1 0 0 1 1 1 1 1 1 1 0 1 1 0 0 0 1 1 1 1 1 1 1 1 0 0 0 0 0 1 1 1 1 1 1 1 1 1 × × × × 0 1 1 1 1 1 1 1 1 × × × 1 × 数 码 控 制 码 输 出 输 入 11.4.1 二进制译码器 由真值表知，当S1=0或 =1时，译码器处于禁止状态，输出全为1；当S1=1， =0时，译码器被选通，处于工作状态，输出如下 ， ， ， ， ， 【例】 试用3/8线译码器74LS138和与非门实现逻辑函数 解：将逻辑函数用最小项表示，然后两次求反。 在数字系统中，通常需要将数字量直观地显示出来，一方面供人们直接读取处理结果，另一方面用以监视数字系统工作情况。因此，数字显示电路是许多数字设备不可缺少的部分。 常用的显示器件：半导体数码管、液晶数码管和荧光数码管等。 (1) 七段数字显示器 g a b c d e f g a b c d e f 由七个发光二极管芯构成，有共阴与共阳两种接法。 (b) 共阳极 (a) 共阴极 半导体数码管两种接法 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 a d b c g f e Ucc A0 A1 A2 A3 GND 七段显示译码器7448的引脚图 (2）七段显示译码器 数字显示译码器是驱动显示器的核心部件，它可以将输入代码转换成相应数字，并在数码管上显示出来。 将“8421”二-十进制代码译成七段显示码，状态表如下：(若为共阳输出，则将输出量中1和0 对换) 输 入 输 出 A3 A2 A1 A0 a b c d e f g 0 0 0 0 1 1 1 1 1 1 0 0 0 0 0 1 0 1 1 0 0 0 0 1 0 0 1 0 1 1 0 1 1 0 1 2 0 0 1 1 1 1 1 1 0 0 1 3 0 1 0 0 0 1 1 0 0 1 1 4 0