PIC 、APIC(IOAPIC LAPIC).docVIP

PIC 、APIC(IOAPIC LAPIC) PIC 、APIC(IOAPIC LAPIC) 1. Overview PIC全称 Programmable Interrupt Controller，通常是指Intel 8259A双片级联构成的最多支持15个interrupts的中断控制系统。APIC全称Advanced Programmable Interrupt Controller，APIC是为了多核平台而设计的。它由两个部分组成IOAPIC和LAPIC，其中IOAPIC通常位于南桥中 用于处理桥上的设备所产生的各种中断，LAPIC则是每个CPU都会有一个。IOAPIC通过APICBUS(现在都是通过FSB/QPI)将中断信息分 派给每颗CPU的LAPIC,CPU上的LAPIC能够智能的决定是否接受系统总线上传递过来的中断信息，而且它还可以处理Local端中断的 pending、nesting、masking，以及IOAPIC于Local CPU的交互处理。 2. PIC 基 于Intel 80x86的PC使用两片8259A级联的方式组成了可以管理15级中断向量的一个中断系统，下图是它的一个连接示意图。两片8259A，一片为 Master，另一片为Slaver。其中Slaver的INT接到Master的IRQ2上。8259A有两种工作模式分别为编程和操作模式。BIOS 初始化的时候会先通过IO port对8259A进行编程配置，在此之后8259A就可以响应来自外部设备的中断请求了。Master的IO address是0x20 0x21; Slaver的IO address是0xA0 0xA1。 为 了能够正常的使用PIC来管理系统中断，就需要对它进行初始化。8259A支持两种类型的命令字，一类是初始化命令字ICW1~4,另一类是操作命令字 OCW1~3,其中每一个命令字的各个bit都有其代表的特定意义。下述是一个初始化Master的一个sample code: MOV AL ;级联，边沿触发，需要写ICW4 OUT 20H,AL ;写ICW1 MOV AL ;中断类型号40H OUT 21H,AL ;写ICW2 MOV AL;主片的IR2引脚从片 OUT 21H,AL ;写ICW3 MOV AL;特殊完全嵌套，非缓冲，自动结束 OUT 21H,AL ;写ICW4 3. APIC Intel APIC由一组中断输入信号，一个24*64bit的Programmable Redirection Table(PRT)，一组register和用于从APIC BUS(FSB/QPI)上传送APIC MSG的部件组成,当南桥的IO device通过IOAPIC的interrupt lines产生interrupt，IOAPIC将根据内部的PRT table格式化成中断请求信息，并将该信息发送给目标CPU的LAPIC，再由LAPIC通知CPU进行处理。下图是一个基于Intel APIC的连接示意图，如下图所示IOAPIC上有24个interrupt pin，每一个pin都对应一个RTE,所以针对每一个interrupt pin都可以单独设定它的mask，触发方式(level,edge trigger),中断管脚的极性，传送方式，传送状态，目的地，中断向量等。 Programmable Redirection Table详细格式如下所示: Bit Description: [63:56] Destination Field-R/W. If the Destination Mode of this entry is Physical Mode (bit 11=0), bits [59:56] contain an APIC ID. If Logical Mode is selected (bit 11=1), the Destination Field potentially defines a set of processors. Bits [63:56] of th