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一 基于VXI总线的时钟产生模块
郭普云 安琪 陈虎成 廖维平 廖娟娟 王砚方
(中国科学技术大学 近代物理系 快电子学实验室 合肥四号信箱230027
.
. . ; 庄听辉 李国庆
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. 1 (深圳华为技术有限公司 中试部 装备开发中心518052
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. . 摘要:时钟信号是通信测试系统中最塞本和最重要的信号 本文介绍了一个叁于VXI总线
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. ‘ 的时钟产生模块,它F用于一个基于VXI的通信测试系统中,提供系统所需的各种
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十 . 时钟.该模块采用了直接数字合成 (DDS)技术,从而实现了精细的时钟频率微调
卜
和可控的时钟抖动.
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e s 关键词:VXI总线,直接数字合成 (DDS)
一 引言
.
1 vxl总线测试平台是公认的21世纪仪器总线系统和自动测试系统的优秀平台。基于VXI总线的模块化仪
器具有很多的优点,例如 易于集成为不同用途的自动测试系统,开放性好,具有优良的交互操作特性,数据
.
. . 传输率高,7靠性好等等。随着vxI总线规范和VXI总线 “即插即用”规范 (PlugPlay)的进一步发展与
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. . 完善,vxI总线越来越广泛地应用到测量、通信、自动控制等领域。基于这些原因,我们设计了这个基于vxi
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总线的时钟产生模块, 应用于一个基于vxl总线的通信测试系统 I【I中,以提供整个测试系统所需要的各种时
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. . 钟信号。
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. 二.基于VXI总线的时钟产生模块的总体概述
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1
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时钟产生模块是一个双槽宽、c尺寸、寄存器基的VXI模块,它能提供两组时钟信号。这两组时钟信号可
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1
. 匕
以按测试系统的要求进行频率的精细调节或抖动.
时钟产生模块的总体框图如下
VXI,O,线 VXI总线接口 功能电路
} {
、、
‘ GPSIOM Hz
输出时钟
.
图I 时钟产生模块的总体框图
33
一
如图1所示,整个时钟产生模块主要由两个部分构成 寄存器基的VXI总线接口部分和时钟产生功能电
路部分。VXI接口部分使得VXI主机能对时钟产生功能电路部分进行控制。时钟产生功能电路部分则是本模块
的功能电路部分,它可以选择三个时钟信号 (外部的GPSIOMHz信号、VX工总线的10MECL时钟信号或本身内
置的三级晶振信号)中的一个为系统的基准时钟源,产生并输出两组时钟信号。
三.时钟产生功能电路的设计
时钟产生功能电路是本模块的核心部分。时钟产生功能电路要产生两组高精度的时钟信号。一组是
40,96MHz,32.768MHz,4.096MHz,2.048MHz和8KHz的时钟信号,这组时钟信号既可以是完全不抖动的时钟,
也可以是抖动幅度和频率均可精细调节的时钟。另一组是高精度的2.048MHz和8KHz时钟信号。这组时钟要求
可以精细调节频率,对 2.048MHz时钟,频率变化步长要小于 0.08Hz,对 8KHz时钟,频率变化步长要小于
0.0003Hz。为了达到这样高的精度
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