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图8.1.1 PLD电路中门电路的惯用画法（a）与门（b）输出恒等于0的与门（c）或门（d）互补输出的缓冲器（e）三态输出的缓冲器 图8.4.6 OLMC5种工作模式下的简化电路（图中NC表示不连接）（a）专用输入模式 （b）专用组合输出模式 （c）反馈组合输出模式 （d）时序电路中的组合输出模式 （e）寄存器输出模式 图8.8.3 ispLSI1032的电路结构框图 图8.8.4 ispLSI1032的逻辑功能划分框图 现场可编程门阵列FPGA（Field Programmable Gate Array） 工艺：CMOS-SRAM 擦除方式：与SRAM相同 基本结构：逻辑单元阵列结构（可编程） 特点：功耗低，集成度高（3万门/片）， 信号传输时间不可预知 8.6 现场可编程门阵列 结构特点： 输入/输出模块（IOB）：输入或输出可设置 可编程逻辑模块（CLB）：含组合逻辑和触发器 互连资源（IR）：金属线，可编程接点/开关 利用EPROM存放编程数据 现场可编程门阵列 FPGA 输入/输出模块（IOB）逻辑原理 低密度PLD：FPLA，PAL，GAL 高密度PLD：FPGA，EPLD 性能特点： 设计灵活性强，适用性广 传输延迟时间不定，速度低， 保密性差 可编程逻辑模块（CLB）逻辑原理 图8.6.4 XC2064的CLB电路 在系统可编程逻辑器件（ISP-PLD）(CPLD) 特点：采用电可擦除，无需编程器 结构特点：与GAL类同，加以改进 输入/输出单元（IOC） 通用逻辑模块（GLB） 可编程布线区：全局布线区（GRP），输出布线区（ORP） GLB结构及功能：与GAL类似 IOC结构及功能：8种工作方式 图8.8.7 图8.8.8 在系统可编程通用数字开关（ispGDS） 通过对IOC编程控制输入/输出以及各IOC之间的连接 * * 第八章 可编程逻辑器件 可编程逻辑器件 ( Programmable Logic Device ) 简称PLD，是一种通用大规模集成电路，用于LSI和VLSI设计中，采用软件和硬件相结合的方法设计所需功能的数字系统。 PLD的优点：价格较便宜，操作简便，修改方便 PLD的分类： 根据有无寄存功能： 可编程组合逻辑器件 可编程时序逻辑器件。 按内部电路组成： PLA（可编程逻辑阵列） PGA（可编程门阵列） 按编程方式： 熔丝编程 光擦编程 电擦编程 在线编程 可擦除PLA和可擦除PGA统称为可擦除PLD，简称EPLD 8.1 可编程逻辑阵列 PLA （Programmable Logic Array） 与阵列输出 + 或阵列输出 任一逻辑函数都可用“与或”式表示，即任何逻辑函数都可以用一个与门阵列与一个或门阵列来实现。 由与阵列和或阵列组成的电路叫做逻辑阵列LA 固定LA ROM（不可编程） 逻辑阵列LA PROM（或阵列可编程） PLA PAL（与阵列可编程） FPLA（与、或阵列皆可编程） PLA同PROM一样，可用熔丝编程， 也可用NMOS，CMOS工艺的光擦和电擦编程。 8.2 现场可编程逻辑阵列 FPLA （Field Programmable Logic Array） 用ROM实现逻辑函数时，地址译码器的每个输出都为一条字线，不能减少。输出函数为标准的与或表达式。 为减小芯片面积，简化 译码器，使输出函数为最 简的与或表达式，采用FPLA。（见例1） FPLA与触发器配合可构成时序逻辑电路（见例2） FPLA规格用输入变量数、与逻辑阵列的输出端数、或逻辑阵列的输出端数三者的乘示。 用户可进行一次编程，使用方便（熔丝型）；也可用叠栅注入式MOS管作为存储单元，如同UVEPROM 例1 D C W1 W2 W3 F1 F2 D’2 D’1 W4 W7 W9 W10 W5 W6 W8 W11 W12 W14 W15 W13 B A W0 4×14×2 D C W1 W2 W3 F1