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计数器及设计
Chapter 5 Combinational Logic Analysis Chapter 5 Combinational Logic Analysis Chapter 5 Combinational Logic Analysis Chapter 5 Combinational Logic Analysis Chapter 5 Combinational Logic Analysis Chapter 5 Combinational Logic Analysis Chapter 5 Combinational Logic Analysis Chapter 5 Combinational Logic Analysis Chapter 5 Combinational Logic Analysis Chapter 5 Combinational Logic Analysis Chapter 5 Combinational Logic Analysis 时序逻辑电路的基本概念 一、 时序逻辑电路的结构及特点 时序逻辑电路——任何一个时刻的输出状态不仅取决于当时的输入信号，还与电路的原状态有关。 时序电路的特点： （1）含有具有记忆元件（最常用的是触发器） （2）具有反馈通道。 第 8 章 计数器 * 时序逻辑电路的设计方法 计数器的实现步骤 1、确定计数器时序并绘制状态图。 2、次态表。从状态图推导次态表。 3、触发器转换表。给出每个转换所需要的触发器输入，转换表与所选触发器类型有关。 4、根据转换表写出触发器输入的卡诺图，每个触发器的输入都有一个卡诺图。 5、根据卡诺图写出触发器输入的逻辑表达式，画出逻辑电路图。 * * 计数器设计实例 设计一个3-位格雷码计数器. Step 1:作出状态图（确定输入变量和输出变量） 初始状态 Step 2: 从状态图推导次态表 PRESENT STATE Q2 Q1 Q0 NEXT STATE Q2 Q1 Q0 0 0 0 0 0 1 0 0 1 0 1 1 0 1 0 1 1 0 1 1 1 1 0 1 1 0 0 0 1 1 0 1 0 1 1 0 1 1 1 1 0 1 1 0 0 0 0 0 4 Step 3: 选定触发器，写出触发器转换表 NEXT STATE Q2 Q1 Q0 PRESENT STATE Q2 Q1 Q0 0 0 0 0 0 1 0 0 1 0 1 1 0 1 0 1 1 0 1 1 1 1 0 1 1 0 0 0 1 1 0 1 0 1 1 0 1 1 1 1 0 1 1 0 0 0 0 0 Q0 从 0变到1 表8-9看出必须 J0=1, K0=X Q1 保持在0 state. 表8-9看出必须 J1=0, K1=X 输出变换 QN QN+1 触发器输入 J K 0 → 0 0 → 1 1 → 0 1 → 1 0 X 1 X X 1 X 0 → * * Step 4: JK值写入卡诺图 对于状态010 次态110，要求 J0=0, K0=X J1=X, K1=0 J2=1, K2=X 直到把所有状态考虑完… 0 X 根据次态表给出各触发器次态卡诺图 * * J 和 K 输入卡诺图 Step 5根据卡诺图写出各触发器输入逻辑表达式 * * Step 6: 计数器电路实现 *
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