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第七章 标准模块化时序逻辑
—计数器
佟冬
Microprocessor RD Center
tongdong@
/courses/Digital/2003spring
1
课程回顾：通用移位寄存器
并
行 并
输 行
入 输
Y 出
X
串行输入 串行输出
移位寄存器
置‘1’信号
模式选择 移位脉冲
清‘0’信号
数字逻辑——时序电路（五） 2003年4月14 日 2
7.3 计数器
计数器的主要功能：
纪录输入脉冲的个数
应用：
计时设备
控制电路
信号产生器
分类：
二进制/非二进制
异步/ 同步
Up/Down
数字逻辑——时序电路（五） 2003年4月14 日 3
计数器的控制信号
同步异步清‘0’clear
使能enable
同步异步装载load
数字逻辑——时序电路（五） 2003年4月14 日 4
7.3.1 同步二进制计数器
n位的同步二进制计数器组成：
n个钟控的JK触发器
初始状态全‘0’
n
状态：0, 1, 2, …, 2 -1, 0
溢出信号
行波进位链
数字逻辑——时序电路（五） 2003年4月14 日 5
上升沿触发JK触发器
特征方程： 激励表：
*
Q S + R Q J K Q C Q*
Q * SC + Q R + C Q 0 0 0 0
* 0 0
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