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Quartus ii 9.0 入门教程 （王宁 UESTC ） Quartus II 是 Altera 公司的综合性 PLD 开发软件，支持原理图、VHDL 、 VerilogHDL 以及AHDL （Altera Hardware Description Language ）等多种设计 输入形式，内嵌自有的综合器以及仿真器，可以完成从设计输入到硬件配置的完 整PLD 设计流程，quartus 是一款功能十分强大的工具软件。 本文以一则实例（一个与门电路）作为切入点来介绍quartus ii 使用，给初学者 一个对软件的初步认识 一：工程建立： 首先双击屏幕上的 ，即可打开quartus ii 9.0 的编译环境 上图中的1 区，是菜单栏，作为初学者不必一一了解，2 区为资源管理栏，用于 显示所建的工程文件信息，3 区是编辑状态显示栏，在编译运行时会显示编译的 实时动态，4 区为工作区，编辑窗口会显示在这里用于编辑，5 区为信息显示窗 口。 应用 quartus 首先应新建一个工程，鼠标点击菜单栏中的 file，选择下拉菜单中 的New project Wizard ，会出现以下窗口 可以在Don’t show me this introduction again 前打 勾，下次新建工程时将不会出 现此窗口，然后 点击 NEXT 出现下面窗口在标志1 处选择工程文件的存储路径，2 是工程名随便输入一个名 字，这里为 wen 。3 是工程的顶层文件名，这里默认与2 相同。4 表示使用现有 的工程设置（这里我们不管他），然后NEXT 下面的窗口不要管，因为不需要加入任何的源文件，直接next 在下面的窗口中，我们一般选择cyclone ll,然后next ，然后再Next 最后finis ，我们就建立了一个新工程 二：原理图建立 上面我们建立了一个工程，下面我们建立一个原理图文件 用鼠标点击file，点击 下拉菜单中的 NEW 会出现下面一个对话框，我们选择Block Diagram/schematic File ，然后点击Ok 接下来我们要添加源器件，在空白处双击鼠标，在弹出的对话框中 name 输入 and2 （下面repeat-insert 前打钩可以连续输入相同的多个器件），点 OK，在编 辑窗口适当位置点击即可放置一个与门器件，用相同的方法添加两个输入 input 和一个输出 output ，在器件input 上双击，弹出属性对话框 取名为x1 ，同样的 方法给另一个input x2，output 为y 。 用鼠标接近引脚当鼠标变十表示字时即可连线，连线如下图，然后保存。 \ 如下图，点击工具栏中的编译图标进行编译，点击编译左边的图标进行定义，编 译成共，确定，定义成功，确定。 然后点击prcessing 下拉菜单中的Generate functional simulation netlist 生成逻辑功能网格，成功，然后点确定。 逻辑功能仿真 首先建立一个仿真文件 file- new--  ,选择基于向量波形的文 件 在下面红