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单片机原理课件推荐

参考资料: ? PC机及单片机数据通信技术 ?李朝青 ---------北京航空航天大学出版社 28.00 * 1.9 MCS-51的中断系统 MCS-51的中断系统结构图 1.9.1中断允许积存器IE 1.9.2中断优先级寄存器IP 1.9.3 优先级结构 1.9.4 中断查询与响应协议 1.9.5 外部中断 1.9.6 中断请求的撤除 1.9.7 中断响应时间 继续 * 中断: CPU中止正在运行的程序,转向为外部设备服务的过程称为中断。当完成中断后,CPU再回到原来的“断点”继续原来的程序。 中断源是由外部产生,具有随机性、不可知性。 主程序 断点 中断相应 中断返回 中断服务程序 * MCS-51的中断系统结构图 MCS-51单片机共有5个中断源(如图所示)。 / int0 T0 / int1 T1 ES 中断源 标识符 高优先级 中断请求 中断矢量 中断源 标识符 低优先级 中断请求 中断矢量 中断请求 寄存器 中断允许寄存器 中断优先级 寄存器 源允许 总允许EA 返回前一次 返回本节目录 * 1.9.1中断允许寄存器IE(0A8H) EA:总允许位。EA=0:禁止一切中断;EA=1中断开放。 ES:串行口中断允许位。ES=1:允许RI、TI引发中断; ES=0:禁止中断。 ET1、ET0:定时器T1、T0允许位。ET=1允许,=0禁止。 EX1、EX0:外中断 int1、int0允许位。ET =1允许,=0禁止。 EA X X ES ET1 EX1 ET0 EX0 返回本节目录 返回前一次 * 1.9.2中断优先级寄存器IP(0B8H) PS:串行口中断优先级设定位; PT1、PT0:定时器T1、T0中断优先级设定位; PX1、PX0:外中断 int1、0中断优先级设定位; X X X PS PT1 PX1 PT0 PX0 返回前一次 返回本节目录 * 1.9.3 优先级结构 由于IP寄存器的设定,将5个中断源分为两个级别。中断的发生将遵循下面的3条基本原则: 1,低级中断在响应执行中,可以被高级中断所中断,反之则不能。 2,一个中断(不论是什么优先级)一旦得到响应,与它同级的中断则不能在中断它。 3,当CPU同时收到几个同一级别的中断要求时,CPU响应哪个中断源取决于硬件的查询顺序(见图)。 转IP寄存器 * 如何改变中断源的优先级顺序 从中断系统的硬件结构图可以清楚地看出同一级别中5个中断源的查询顺序。很明显,要改变这种顺序只能通过IP的设置。 如:要想将串行口的级别设为最高时,将IP中的PS置一。 既使用指令:setb ip.ps 或 mov 0b8h,#10h 完成对IP设置。 X X X PS PT1 PX1 PT0 PX0 IP寄存器 返回本节目录 返回前一次 * 1.9.4 中断查询与响应协议 在每一个机器周期中,所有的中断源都要按照其顺序检查一遍,到S6状态时,就查找到所有被激活的中断申请并排好优先权。在下一个机器周期的S1状态,只要不受阻断,就开始响应高级中断。 如果发生下列情况,中断将被阻止: 1,同级或高级中断正在执行时; 2,当前的机器周期不是指令的最后一个机器周期; 3,CPU正在执行的指令是RETI或访问IE、IP寄存器时,CPU是不会响应中断,而且要等到该指令的下一条指令执行完后中断才能响应。 返回前一次 * CPU查询到某一中断源后,使相应的“优先级激活”触发器置位用以阻断同级或低级中断。在硬件的控制下,程序自动转向对应的矢量单元,执行其服务程序。 CPU响应中断时,将当时程序计数器PC的内容进栈,并将相应的中断矢量装入PC中,使CPU转向对应的服务程序。 中断服务程序的最后一条指令是RETI,指令将清除“优先级激活触发器”,然后从堆栈中弹出断点地址并装入到PC中。 矢量入口的指令应当是转移指令。 (上电启动地址) (INT0中断入口) (T0中断入口) (INT1中断入口) (T1中断入口) (串口中断入口) 0000H 0003H 000BH 0013H 001BH 0023H 返回本节目录 * 1.9.5 外部中断 在MCS-51引脚上有:INT0、INT1两个外部的中断输入,作为外部事件的触发信号。CPU在每一个机器周期对它们进行一次检测。系统设定了两种触发方式:边沿触发(下降沿)和电平触发(低电平)。具体由TCON中的IT0、IT1来确定。 1,在边沿触发方式中,在相邻的两个机器周期,如果第一次采集是高电平,第二次采集是低电平时,则TCON中的标志IE0或IE1置位。所以,在

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