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vhdl基本语法16
Verilog HDL 的基本语法
——周立功Actel产品线
版板所有© 广州周立功单片机发展有限公司 2007
系统任务和编译预处理语句 目录
目 录
1 调试用的系统任务
2 常用编译预处理语句
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系统任务和编译预处理语句 系统任务
系统任务($monitor)
提供监控和输出参数列表中的表达式或变量值功能
多模块调用$monitor
$monitor($time,,”rxd=%b,txd=%b”,rxd,txd);
在多模块调试的情况$monitor 需配合$monitoron和$monitoroff
控制持续监视,因为任何时刻只能有一个$monitor起作用。
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系统任务和编译预处理语句 系统任务
系统任务($time)
利用时间系统函数可以得到当前的仿真时刻
$time
$realtime
$time返回64位的整数来表示当前仿真时刻值,时刻以模块
的时间尺度为基准——$time输出时刻总是时间尺度的倍数
$realtime返回的时间数字是一个实型数,数字也是以时间尺
度为基准的
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系统任务和编译预处理语句 系统任务
系统任务($time)
利用时间系统函数可以得到当前的仿真时刻
$time
$realtime
程序示例
`timescale 10ns/1ns $time set
parameter p=1.6;
initial 0 x
begin
$monitor($time, “set=”,set); 2 0
#p set = 0;
#p set = 1; 3 1
end
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系统任务和编译预处理语句 系统任务
系统任务($time)
利用时间系统函数可以得到当前的仿真时刻
$time
$realtime
程序示例
`timescale 10ns/1ns $realtime set
parameter p=1.6;
initial 0 x
begin
$monitor($realtime, “set=”,set); 1.6 0
#p set = 0;
#p set = 1; 3.2
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