官方说明书MOTOROLA MCM67J518 数据手册.pdfVIP

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2018-05-11 发布于浙江
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官方说明书MOTOROLA MCM67J518 数据手册.pdf

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官方说明书MOTOROLA MCM67J518 数据手册

MOTOROLA MCM67J518 handbook /file/2626959 From ManualL ManualL collects and classifies the global product instrunction manuals to help users access anytime and anywhere, helping users make better use of products. Home: / Chinese: / This Manual: /file/2626959 Order this document SEMICONDUCTOR TECHNICAL DATA by MCM67J518/D MCM67J518 32K x 18 Bit BurstRAM Synchronous Fast Static RAM With Burst Counter and Registered Outputs The MCM67J518 is a 589,824 bit synchronous static random access memory designed to provide a burstable, high–performance, secondary cache for the i486 and Pentium microprocessors. It is organized as 32,768 words of 18 bits, fabricated with Motorola’s high–performance silicon–gate BiCMOS technol- FN PACKAGE ogy. The device integrates input registers, a 2–bit counter, high speed SRAM, PLASTIC CASE 778–02 and high drive registered output drivers onto a single monolithic circuit for re- duced parts count implementation of cache data RAM applications. Synchro- nous design allows precise cycle control with the use of an external clock (K). BiCMOS circuitry reduces the overall power consumption of the integrat