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基于VHDL的卷积码编解码器的设计 PAGE \* MERGEFORMAT PAGE \* MERGEFORMAT 1 长沙理工大学 《通信电路EDA》课程项目报告 系 别 水利计通系 专 业 通信工程 班 级 通信1003班 指导教师 项目组组长 学 号 项目组成员 学 号 项目组成员 学 号 项目组成员 学 号 完成日期2012年11月14日 PAGE 40 PAGE 16 目 录 TOC \o 1-3 \h \u HYPERLINK \l _Toc6925 1 引 言 PAGEREF _Toc6925 3 HYPERLINK \l _Toc24242 1.1项目背景 PAGEREF _Toc24242 3 HYPERLINK \l _Toc1879 2 卷积码编解码器的结构概述 PAGEREF _Toc1879 4 HYPERLINK \l _Toc3355 2.1 卷积码编码器的结构 PAGEREF _Toc3355 4 HYPERLINK \l _Toc11619 2.2 卷积译码器的结构 PAGEREF _Toc11619 4 HYPERLINK \l _Toc26050 3 卷积码编解码器的VHDL 设计 PAGEREF _Toc26050 5 HYPERLINK \l _Toc10031 3.1 VHDL 设计的优点与设计方法 PAGEREF _Toc10031 5 HYPERLINK \l _Toc16573 3.2 卷积码编码器的VHDL 实现 PAGEREF _Toc16573 5 HYPERLINK \l _Toc16960 3.2.1 卷积编码器顶层建模的VHDL 描述 PAGEREF _Toc16960 5 HYPERLINK \l _Toc23584 3.2.2 用MAX+PLUSⅡ编译后生成的编码器图形符号 PAGEREF _Toc23584 7 HYPERLINK \l _Toc22649 3.2.3 卷积编码器VHDL仿真波形 PAGEREF _Toc22649 7 HYPERLINK \l _Toc22002 3.3 卷积码解码器的VHDL实现 PAGEREF _Toc22002 7 HYPERLINK \l _Toc21676 3.3.1 卷积解码器顶层建模的VHDL 描述 PAGEREF _Toc21676 7 HYPERLINK \l _Toc18176 3.3.2 用MAX+PLUSⅡ编译后生成的解码器图形符号 PAGEREF _Toc18176 9 HYPERLINK \l _Toc26793 3.3.3 卷积解码器VHDL仿真波形 PAGEREF _Toc26793 9 HYPERLINK \l _Toc3372 4 参考文献 PAGEREF _Toc3372 9 HYPERLINK \l _Toc26843 5 后记 PAGEREF _Toc26843 10 基于VHDL的卷积码编解码器的设计 1 引 言 1.1项目背景 现代数字通信有两个基本的理论基础,即信息论和纠错编码理论,它们几乎是同时在第二次世界大战结束后不久诞生的。前者首先由Shannon以他的不朽名著“通信的数学理论”为标志建立起来的,而后者则以Hamming的经典著作“纠错和检错编码”为代表。Shannon信息论主要讨论信息的度量,以及对于信息表示和信息传输的基本限制。信道编码定理告诉我们,只要信息传输速率小于信道容量,则信息传输可以以任何小的错误概率进行。但是,Shannon信息论并没有告诉我们如何去实现这一点。Hanmming提出的纠错编码理论正是为了解决这个问题。 科学技术的发展使人类跨入了高度发展的信息化时代。在政治、军事、经济等各个领域，信息的重要性不言而喻，有关信息理论的研究正越来越受到重视。20世纪50年代信息论在学术界引起了巨大的反响。20世纪60年代信道编码技术有了较大进展，成为信息论的又一重要分支。信道编码技术把代数方法引入到纠错码的研究，使分组码技术的发展到了高峰，找到了大量可纠正多个错误的码，而且提出了可实现的译码方法。20世纪70