模拟集成电路设计ch9运算放大器3高增益轨到轨全差分运放.pptxVIP

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2018-09-23 发布于上海
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模拟集成电路设计ch9运算放大器3高增益轨到轨全差分运放.pptx

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模拟集成电路设计ch9运算放大器3高增益轨到轨全差分运放

典型的运放结构和种类筒套式共源共栅运算放大器折叠式共源共栅运算放大器高增益运算放大器轨对轨运算放大器全差动运算放大器高增益运算放大器引入串联反馈！怎样进一步增加输出阻抗而不增加更多的共源共栅器件？高增益运算放大器辅助放大器的实现方式高增益运算放大器采用PMOS辅助放大器可以克服这个问题高增益运算放大器高增益运算放大器高增益运算放大器性能比较增益摆幅速度功耗噪声套筒式共源共栅中中高低低折叠式共源共栅中中高中中两极运放高高低中低增益提高运放高中中高中典型的运放结构和种类筒套式共源共栅运算放大器折叠式共源共栅运算放大器高增益运算放大器轨对轨运算放大器全差动运算放大器轨对轨运算放大器PMOS、NMOS的输入范围分别在上下轨受限PMOS、NMOS并联工作典型的运放结构和种类筒套式共源共栅运算放大器折叠式共源共栅运算放大器高增益运算放大器轨对轨运算放大器全差动运算放大器全差动运算放大器全差动的优点：更好的抑制共模信号和噪声的能力，更好的速度，更大的输出摆幅共模反馈（ CMFB）静态工作点可以“目测”的简单差动对共模反馈静态工作点不能“目测”的差动对要使Vout的静态电平在VDD/2 附近，应有IP=IN如果IPIN 则Vout会上升，把P管压入线性区（从而P管电流减小到很N管一样）；如果IPIN 则Vout会下降，发生相反的过程。共模反馈CMFB的原理结构图共模检测电路检测出共模电平，与VREF（一般为VDD/2）进行比较，如果共模电平大于VREF ，则增大尾电流，从而降低共模电平。如果小于，则相反。即通过负反馈使共模电平稳定在VREF