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pwm信号发生器实验报告.doc
EDA
学院:电气学院 班级:电科1班
学号:12401720126
姓名:刘明煌
实验三PWM信号发生器的设计
实验目的
进一步熟悉掌握Quartus II。
进一步熟悉和掌握GW48-CK或其他EDA实验开发 系统的应用。
学习和掌握VHDL进程语句和元件例化语句的使用。
实验内容
设计并调试好PWM信号发生器电路PWM.VHD,并用 GW48-CK或其他EDA实验开发系统进行硬件验证。
实验条件
开发软件:Quartus II。
实验设备:GW48-CKEDA实验开发系统。
拟用芯片:EP2C8Q208C8N。
实验设计
系统原理框图
为了简化设计并便于显示,本信号发生器电路PWM的设计 分为两个层次,其底层电路可,再由包括两个完全相同的加 载加法计数器LCNT8而成。
PWM电路
Cyclon? II EP2C5Q20eC8 ?淼 PWfl?说 ITFT8 VI 以 LCFT8 U2cbIn:pr:Fil妝ZBOO hHl?o$
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TypeInessage
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田 田
InCo: Coximand: quactus_slu --cead_3ettmgs_£iles=on --wcite_setting3_Ciie3=oC£ pum -c pwu Info: Using vector source rile ”CDocuments and Settirigs/Ovner/jftffi/maa/pwn/pim.vur. Into: Option to pcesecve fewer signal transitions co reduce mexxory requicenents is enabled Into: Simulation partitioned into 1 sub-3imulations
Info: Simulation coverage is 77.33 %
Info: Munbec of transitions m simulation is 50002
Inco: Quactus II Smulacor was successful. 0 errors, 0 uatnmgs
5Z
Quartus II - C:/Docuents and Settings/Orner/京面/ni^a/po/po
-pn - [RTL Viewer]
咬 File Elit Vie* Project Assi^ixtents Processing Tools Windov Help
-5 X
□ B 0 ■ X 电 |pwn d M Z
Prnlpft KlAvin^nr x ~: 1
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p学 I 1 of 1
!?|\ System (27) Processing (9) fy Extra Info \ Info (9) \ Warnrg \ Critical V/arnng 入 Error 入 Stppresied 入 Flag /
C |Messag? 0rf 16~ —土土J[T=
For H^lp^ pr?ss FIQu^rtus n - C Z~ CATmmz 1:49
For H^lp^ pr?ss FI
Qu^rtus n - C Z
~ CAT
mm
z 1:49
VHDL程序
PWM信号发生器的底层和顶层电路均采用VHDL文本输 入,有关VHDL程序如下。
加载加法计数器LCNT8的VHDL源程序:
LIBRARY IEEE;
USE IEEE.STD LOGIC 1164.ALL;
ENTITY LCNT8 IS
PORT(CLK,LD:IN STD_LOGIC;
D:IN INTEGER RANGE 0 TO 255;
CAO:OUT STD一LOGIC);
END ENTITY LCNT8;
ARCHITECTURE ART OF LCNT8 IS
SIGNAL COUNT:INTEGER RANGE 0 TO 255;
BEGIN
IF CLKEVENT AND CLK= 1 THEN
IF LD=1THEN COUNTED;
ELSE COUNT=COUNT+1;
END IF;
END IF;
END PROCESS;
PROCESS(COUNT) IS
BEGIN
IF COUNT=255 THEN CAO=1;
ELSE CAO=0
END IF;
END PROCESS;
E
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