基于Verilog＋HDL语言的CAN总线控制器设计及验证.pdfVIP

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2019-03-14 发布于浙江
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基于Verilog＋HDL语言的CAN总线控制器设计及验证.pdf

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2012年5月15日现代电子技术 2012 May ModernElectronics 第35卷第10期 Technique V01．35No．10 基于Verilog 许莉娅1，段帅君2，李传南2 130012) (1．黎明职业大学机电工程系，福建泉州362000；2．吉林大学电子科学与工程学院，吉林长春摘要：在此利用VerilogHDI．设计了一款cAN总线控制嚣，首先根据协议把整个CAN总线控制器划分为接口逻辑管理、寄存器逻辑和cAN核心模块3个模块，然后用Ve“log CAN 件对各个模块的功能进行了仿真，最后使用FPGA芯片对设计的CAN总线控制器验证，并连接了一个包舍该FPGA 总线控制器的4节点cAN总线网络。测试结果表明所设计的cAN总线控制器能够完成设定的功能。 HDL 关键词：CAN总线；控制器；FPGA；Ve“109 中图分类号：TN919—34；TP336文献标识码：A 文章编号：1004—373X(2012)10一0043一04 andconfirmationofCANbuscontroUerbasedon HDL Design Ve“Iog XU Chuan_nan2 Li—yal，DUANShuai—jun2，LI ofMechanicalandElectrlcal Universities，Quanzhou36Z000，China； (1．Department EngineeringLiming 2．CollegeofElectronicScienceand 130012ChinⅡ) Eng．neering．JilinUnivershy，Changchun Abstract：oneofCANbuscontrollerwas with HDLandtestedtheaidofa FPGAchi type designedVe“log by CycIone p． ThisCANbuscontmllerwasdividedintothreefunctional m。dules：interface moduIeand managementlogicmodule，register CANcoremodule． modulewas withVe HDL totheirfunctions．Thefunctionsofthese Every designed rilog according modulesweresimulatedmeansofthesoftware by Modelsim．TheCANbuscontrollerwasverifiedFPGA tested