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2019-04-12 发布于广西
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基于NE564D锁相环频率合成器的设计.pdf

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已翟茎釜虫基于NE564D锁相环频率合成器的设计 The ofPLL BasedonNE564D Design Frequency Synthesizer 曾素琼(嘉应学院电子信息工程学院，广东梅州514015) ElectronicsandInformation ZengSu-qiong(sch砌of Engineer,JiayingUniversity，Guangdong Meizh㈣5I加15) 擒要：设计基于NE5“D约锁相频率合成器。对系统的实现作了详细描述．最后对系统作了实验验证及分析。关键词：锁相环；锁相频率合成器；压控振荡器(VCO)；NE564D 中图分类号：TP273；TN915 文献标识码：B 文章编号：1003--0107(2010)01--0016-03 Alll,lltrllcleInthis based The paper．PLLfrequencysynthesizeronNE564is realLzationofthe wa8describedin designed sy。lom detail verificat“00and ofthe FlnaIIy。experimentalanal／zealsystemwwem8de 妇叶word·：phase-lockedlOOp；PLLfrequencysynthesizer；螂aOe—cor删Iedoscillator(VCO)；NE564D Decsmumt Ct,C帅mb靠忡273；TN915 todsc．B^r嘲●∞：1003-0107(2010)01—0018_03 1基于NE564D锁相环频率合成器的设计思路与系统框图工作电压5～12V，典型工作电压为5V，典型工作电流为 60mA，最大允许功耗为40mV；在频偏为±10％，中心频率为锁相环NE564D是一种工作频率可高达50MHz的常用超高频集成锁相环，利用74LS393(74LS393是双四位二进制计大于或等于200mVp—P。数器)作为频率合成器的分频器，组成倍频锁相环频率合成器。合成器输出频率为fo=Nfr。式中fr为参考频率，通常是用高稳定度的晶体振荡器产生，对晶振频率固定之后获得的。这种 -人1．．y。h：一队1． 1 合成器的分辨率为fr。系统框I冬j如图l所示。盖宣时电寡 ■ 图2NE564D内部电路原理图图1基于NE564D锁相环频率合成器的系统框图 3基于NE564D锁相频率合成主要电路设计 2NE564D芯片介绍 3．1锁