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Motion JPEG视频压缩IP核的设计与实现 2008-06-23 14:22:40 作者：李大舟 来源：中电网 引言 随着多媒体技术及通信技术的快速发展，在嵌入式平台上实现连续图像压缩的需求已变 得日益广泛。常用的系统结构是独立处理器配和专用图像压缩芯片或者是只用一个高主频的 数字信号处理器完成主要功能。但随着大规模集成电路技术的发展及市场对产品低成本的要 求不断提高，一种新的在嵌入式平台上实现连续图像压缩的系统结构正逐步成为上述两种系 统结构的替代者。这种新的结构就是Altera公司提出的基于Avalon总线的SOPC结构。 SOPC结构可以把处理器，图像压缩IP核，通讯单元及控制单元集成到--块FPGA芯片上。 较之以往的结构，不但极大地节约了系统资源和成本，更是减少了系统的复杂度。尤其是可 以用硬件电路实现软件处理极为耗吋的运算功能，使得在低主频，低功耗的嵌入式平台上实 现连续图像实吋压缩变为可能。连续图像压缩IP核也成为整个SOPC系统的一个关键部件。 现有的MPEG系列，H26X系列IP核对FPGA的芯片资源及性能要求极高，难以满足系统 对低成本，低功耗的要求。所以设计一个适合低成本，低功耗的FPGA芯片的视频压缩IP 核变得极为重要。这即要求压缩算法的复杂度不能太高，又要求有适当的压缩效果，Motion JPEG算法恰好满足上述要求。 1 .Motion JPEG