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;参考资料;浅谈基于FPGA的电路设计;温馨提示;;FPGA概述;可编程逻辑器件的发展历程;PLD发展历程及现状;三大公司;2005年第1季度（1～3月）结算 公司名称
;ALTERA公司器件简介;XiLinx公司器件简介;Lattice公司器件简介;代理商;基本PLD器件的原理结构图;内部结构及实现原理;内部结构及实现原理;基于乘积项;基于查找表;传统CPLD/FPGA的区别;主要开发平台;第三方工具;硬件开发语言;ABEL;AHDL;Verilog;VHDL;开发设计;软件设计流程;; Step1 建立工作库文件夹;Step2 编辑输入并保存VHDL源文件;Step3 在文本编辑窗中输入VHDL文件及存盘;文件存盘后，
关键词将改变
颜色！否则文
件名一定有错！;Step4 将当前设计设定为工程;注意，此路径指
向当前的工程！;首先选择这里;选择编译器; 选择VHDL文本编译版本号和排错;选择此项;编译出错！; 确定设计文件中的错误;错误所在;改正错误;完成编译！;首先选择此项，
为仿真测试新
建一个文件;从SNF文件中
输入设计文件
的信号节点;SNF文件中
的信号节点;消去这里的勾，
以便方便设置
输入电平;选择END TIME
调整仿真时间
区域。;用此键改变仿真
区域坐标到合适
位置。;设置输入信号‘a’
的周期为2us;仿真波形文件
存盘！;选择仿真器; mux21a仿真波形;选择引脚
锁定选项;此处输入
信号名;再编译一次，
将引脚信息
进去;选择编程器，
准备将设计
好的半加器
文件下载到目
器件中去;在编程窗打开
的情况下选择
下载方式设置;下载（配置）
成功！;下载配置模式;;下载板电路图;下载板电路图;用户板的制作;;;;设计中注意事项;软件设计注意点;;;;;硬件设计注意点;命名方法;选型指南;特殊要求
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