实验四 七段数码管的动态扫描显示.docxVIP

实验四七段数码管的动态扫描显示 专业：电子信息科学与技术姓名：高晓骏学号：2012021199010 一．实验目的 （1）进一步熟悉QuartusII软件进行FPGA设计的流程； （2）掌握利用宏功能模块进行常用的计数器，译码器的设计； （3）学习和了解动态扫描数码管的工作原理的程序设计方法； 二．实验器材 （1）PC机 （2）QuartusII开发工具软件 三．实验原理 实验板上常用4位联体的共阳极7段数码管，其接口电路是把所有数码管的8个笔划段a-h同名端连在一起，而每一个数码管由一个独立的公共极COM端控制。 当向数码管发送字形码时，所有数码管都接收到相同的字形码时，但究竟是那个数码管亮，取决于COM端，这一端是由I/O控制的，所以就可以自行决定何时显示哪一位。动态扫描即采用分时方法，轮流控制各个LED轮流点亮。 在轮流点亮扫描过程中，每一位显示器的点亮时间是极为短暂的，但由于人的视觉暂留现象及发光二极管的余辉效应，尽管实际上每个显示器并非同时点亮，但只要扫描的速度足够快，给人的印象就是一组稳定的显示数据，不会有闪烁感。 四、实验要求： 实现显示0000-9999的十进制计数器。 五．实验内容及步骤 1.建立工程 建立名为leddisplay的工程，并建立顶层图。 2.设计计数时钟 设计一个分频器，对50MHz分频输出到计数器，让计数器以较慢的速度递增。 moduleint_div(clk,div_out); inputclk; outputregdiv_out; reg[31:0]clk_div; parameterCLK_FREQ=D50_000_000; //系统时钟50MHz parameterDCLK_FREQ=D10; //输出频率10/2Hz always@(posedgeclk) begin if(clk_div(CLK_FREQ/DCLK_FREQ)) clk_div=clk_div+1; else begin clk_div=0; div_out=~div_out; end end endmodule 输入完成后，将该文件设为顶层实体，该命令在Project-Setastop-levelEntity。 分析该设计文件:执行工具栏处的“StartAnalysisSynthesis命令按钮，开始分析综合，此步骤在这里用于检查设计错误。 分析成功后要生成一个分频器的元件符号，执行File-CreateSymbolfilesforcurrentfile,开始建立该文件的元件符号。 3.调用宏功能模块设计计数器 modulecnt10000(qout,clr,clk); input clr; inputclk; output[15:0]qout; reg[15:0]qout; always@(posedgeclk) if(!clr)qout[15:0]=0; elseif(qout[3:0]==9) begin qout[3:0]=0; if(qout[7:4]==9) begin qout[7:4]=0; if(qout[11:8]==9) begin qout[11:8]=0; if(qout[15:12]==9)qout[15:12]=0; elseqout[15:12]=qout[15:12]+1b1; end elseqout[11:8]=qout[11:8]+1b1; end elseqout[7:4]=qout[7:4]+1b1; end elseqout[3:0]=qout[3:0]+1b1; endmodule 输入完成后，将其设为顶层实体，检验后生成元件符号。 4.数码管扫描显示程序设计（不含小数点） modulesegmain(clk,reset_n,datain,seg_data,seg_com); inputclk; inputreset_n; input[15:0]datain; output[7:0]seg_data; output[3:0]seg_com; reg[3:0]seg_com; reg[7:0]seg_data; reg[3:0]bcd_led; reg[26:0]count; always@(posedgeclk) begin if(!reset_n) count=0; else count=count+1; end always@(count[14:13]ordatain) begin case(count[14:13]) 2b00: begin bcd_led=datain[3:0]