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第12章 AltLab库 第12章 AltLab库 12.1 Signal Compiler模块 12.2 Subsystem Builder模块 12.1 SignalCompiler模块 SignalCompiler模块是DSP Builder的心脏。其主要功能如下： ● 将Simulink设计转变成可综合的RTL级VHDL代码。 ● 产生VHDL testBenches。 ● 将Simulink仿真激励输出给VHDL testbenches，并且产生ASCII格式的文件。 ● 为LeonardoSpectrum、Synplify和Modelsim第3方EDA工具产生Tcl脚本文件。 ● 为Quartus?II的仿真产生仿真矢量文件(.vec)。 ● 产生PTF配置文件，可用于将设计自动地输给SOPC Builder工具。 ● 能帮助产生嵌入式逻辑分析仪SignalTap?II文件.stp。 用户可以利用SignalCompiler控制设计系统的综合、编译和仿真的流程。 12.1.1 综合域编译流程 如前所述，综合域主要有自动和手动两个流程，归纳如下： 1. 自动流程 自动流程允许设计者仅利用SignalCompiler模块在MATLAB/ Simulink环境中就能控制整个设计