VHDL实验报告(整理)(一).pdfVIP

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学 海 无 涯 专用集成电路实验报告 13050Z01 1305024237 刘德文 1 学 海 无 涯 实验一 开发平台软件安装与认知实验 实验内容 1、 本实验以三线八线译码器(LS74138)为例,在Xilinx ISE 9.2 软件平台上完成设计 电路的VHDL 文本输入、语法检查、编译、仿真、管脚分配和编程下载等操作。下载芯 片选择Xilinx 公司的CoolRunner II 系列XC2C256-7PQ208 作为目标仿真芯片。 2、 用1 中所设计的的三线八线译码器(LS74138)生成一个LS74138 元件,在Xilinx ISE 9.2 软件原理图设计平台上完成LS74138 元件的调用,用原理图的方法设计三线八线译 码器(LS74138),实现编译,仿真,管脚分配和编程下载等操作。 源程序: library IEEE; use IEEE.STD_LOGIC_1164.ALL; use IEEE.STD_LOGIC_ARITH.ALL; use IEEE.STD_LOGIC_UNSIGNED.ALL; -- Uncomment the following lines to use the declarations that are -- provided for instantiating Xilinx primitive components. --library UNISIM; --use UNISIM.VComponents.all; entity ls74138 is Port ( g1 : in std_logic; g2 : in std_logic; inp : in std_logic_vector(2 downto 0); y : out std_logic_vector(7 downto 0)); end ls74138; architecture Behavioral of ls74138 is begin process(g1,g2,inp) begin if((g1 and g2)=1) then case inp is when 000=y when 001=y 2 学 海 无 涯 when 010=y when 011=y when 100=y when 101=y when 110=y when 111=y when others=y end case; else y end if; end process; end Behavioral; 波形文件: 生成元器件及连接电路 思考: 有程序可以看出,定义了三个输入端,一个输出端。g1,g2 为使能输入端,当

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