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2021-01-22 发布于天津
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通信电子实验室软件使用说明 Quartus II 的 AS/JATG 下载方式教程 V1.0 版本BY GJH 计通学院通信电子实验室二?一五年八月十二日通信电子实验室软件使用说明一、简介 1.1三种方式有些人对于FPGA下JTAG的下载方式有些迷惑，为什么出现配置芯片了，为什么要用不同的下载电缆，不同的下载模式？通过在网上查阅相关资料做了总结和整理如下： FPGA器件有三类配置下载方式：主动配置方式(AS )和被动配置方式(PS) 和最常用的(JTAG)配置方式。 AS模式(active serial con figuration mode):FPGA器件每次上电时作为控制器，由FPGA器件引导配置操作过程，它控制着外部存储器和初始化过程，从配置器件EPCS主动发出读取数据信号，从而把 EPCS的数据读入FPGA中，实现对FPGA的编程配置数据通过 DATA0引脚送入FPGA,配置数据被同步在DCLK输入上，1个时钟周期传送1位数据。 PS模式(passive serial configuration mode)则由外部计算机或控制器控制配置过程。通过加强型配置器件(EPC16, EPC8, EPC4)等配置器件来完成， EPCS作为控制器件，把FPGA当作存储器，把数据写人到FPGA中，实现对FPGA的编程。 JTAG： JTAG是直接烧到 FPGA里面的由于是SRAM 断电后要重烧，AS 是烧到FPGA的配置芯片里保存的每次上电就写到FPGA里。图1-1可下载格式一览表