TPU 神经网络加速器IP核 - 阿吉毕科技（RJIBI）.pdf

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2021-06-14 发布于广东
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阿吉毕科技—— FPGA 方案专家 TPU 神经网络加速器IP 核 ETPU神经网络加速器IP 核为张量计算处理器，为张量运算集架构实现的张量处理器，可独立完成取指令、取数据、数据预处理、数据计算等神经网络任务，并拥有存储器（DDR）和存算一体（PiM）两种体系结构，提供配套的TPUSDK编译器，可将Caffe、ONNX、Darknet、 NCNN等框架训练的神经网络编译后直接用于FPGA加速部署，从而用于深度神经网络的硬件加速。基于ETPU的神经网络加速方案具备有如下优势： 自主可控从完全自主知识产权的指令集、处理器架