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组合逻辑电路习题解答4.1.1一编码器的真值表如下所示,试用或非门和反相器设计该编码器的逻辑电路. 输 入 输 出 I3I2 I1 I0D7 D6 D5 D4 D3D2 D1 D0 1 0 0 0 0 1 0 0 0 0 1 0 0 0 0 10 1 1 0 0 1 11 1 0 1 0 1 0 10 1 1 1 1 0 1 01 1 0 0 1 1 0 1分析：0少1多，题目要求用或非门实现，故采用取0的方法。解：D7=I 3I 2I 1I0=I 3+I 2+I 1+I0=D0D6=I 3+I 2+I 1+I0D5=I 3+I 2+I 1+I0+I 3+I 2+I 1+I0=D1D4=I 3+I 2+I 1+I0D3=I 3+I 2+I 1+I0+I 3+I 2+I 1+I0D0D6D3D2D1D7D5D411111111D2=I 3+I 2+I 1+I0+I 3+I 2+I 1+I0≥1≥1≥1≥1≥1≥1≥1≥1≥1I3I3I2I2I1I1I0I0解：令三个输出分别为：Y1=ABCD，Y2=ABCD，Y3=ABCD，则可直接画出译码器的逻辑图。Y2Y1Y3﹠﹠﹠ABCD4.2.1试用与非门设计一译