第十二章时序逻辑电路.ppt

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2021-10-29 发布于山东
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第十二章时序逻辑电路.ppt

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1. 异步二进制加法计数器 J RD K CP Q Q J RD K CP Q Q J RD K CP Q Q 清零计数脉冲 CP F0 F1 F2 Q0 Q1 Q2 （一）二进制计数器一个触发器有两个稳态，N个触发器共有2N个稳态，若计数器有N个触发器，称该计数器为模数2N计数器，计数容量是（2N-1）各触发器 J=K=1 低位的Q端接高位的CP。 CP脉冲不同时加到CP端 12.4 计数器用来累计脉冲数目第12章12? 4 C Q2 Q1 Q0 0 0 0 0 1 1 1 0 0 0 1 1 1 1 0 1 0 0 1 0 1 1 0 1 0 1 2 3 4 5 6 7 8 0 0 0 加法计数器状态表 J RD K CP Q Q J RD K CP Q Q J RD K CP Q Q 清零计数输入 CP F0 F1 F2 Q0 Q1 Q2 CP Q0 Q1 Q2 （一）二进制计数器 1. 异步二进制加法计数器 000 010 011 100 101 110 111 001 000 第12章12? 4 ? J RD K CP Q Q ? ? J RD K CP Q Q ? ? J RD K CP Q Q ? ? J RD K CP Q Q ? ? ? ? 1 ? ? 计数输入清零 Q0 Q1 Q2 Q3 3 4 5 6 1 2 7 8 9 10 11 12 13 14 15 16 CP Q0 Q1 Q2 Q3 F0 F1 F2 F3 分频的概念？ 1. 异步二进制加法计数器 0000 0001 0010 0011 0100 0101 0110 0111 1000 1001 1010 1011 1100 1101 1110 1111 0000 SD RD C Q Q ? D SD RD C Q Q ? D SD RD C Q Q ? D 用D触发器构成的异步二进制加法计数器计数输入 CP 清零 Q0 Q1 Q2 CP Q0 Q1 Q2 F0 F1 F2 低位的Q端接高位触发器的CP端（一）二进制计数器 1. 异步二进制加法计数器第12章12? 4 2. 异步二进制减法计数器 C Q2 Q1 Q0 0 0 0 0 1 2 3 4 5 6 7 8 0 0 0 减法计数器状态表 1 1 1 1 1 0 1 0 1 1 0 0 0 1 1 0 1 0 0 0 1 Q2 J RD SD K CP Q Q J RD SD K CP Q Q J RD SD K CP Q Q 置数计数输入 CP Q0 Q1 F0 F1 F2 第12章12? 4 ? J K CP Q Q ? J K CP Q Q ? J K CP Q Q ? ? J K CP Q Q ? ? ? ? ? CP 1 ? ? ? ? J0 = K0= 1 J1 = K1 = Q0 J 3= K3 = Q2? Q1?Q0 Q0 Q1 Q2 Q3 J2 = K2 = Q1? Q0 ? ? F0 F1 F2 F3 3. 同步二进制加法计数器计数脉冲同时加到触发器的时钟端 CP Q3 Q2 Q1 Q0 0 0 0 0 0 1 0 0 0 1 2 0 0 1 0 3 0 0 1 1 4 0 1 0 0 5 0 1 0 1 6 0 1 1 0 7 0 1 1 1 8 1 0 0 0 9 1 0 0 1 10 1 0 1 0 11 1 0 1 1 12 1 1 0 0 13 1 1