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测试案例集锦4——出淤泥而不得不染
这次的Debug案例来自某串行芯片设计厂家，发现某板子出来的串行SERDES信号与其他单板对接有问题。
首先进行眼图测试。
这个眼图很明显地存在低频抖动。
再看一下时域的抖动分布。
以0点为中心对称，典型的周期性抖动。既然是周期性的，就可以查看一下频域的特性了：
很遗憾测试当时没有把该矢量图局部放大，因为最左边的三条竖线代表的频谱就是这个抖动的频点，500KHz以及1MHz，1.5MHz谐波。
在测试配置中加入1MHz带宽的二阶锁相环设置，将抖动分量最大的500kHz抖动干掉后，眼图和时域分布如下，频域上最左边那条500k线的幅值被降低了30倍。
也就是说，如果对方接收端芯片中有1MHz的二阶PLL电路，这个低频抖动就可以被干掉，不会影响工作。现代的高速串行传输系统中，接收端一般都会有PLL，来提高工作的抗干扰性能。
不过测试的目的是用于Debug，PLL再牛，也是傻小子睡凉炕全凭火力旺，还是得治本才行。500KHz左右的频率，通常都是开关电源的工作频率，用探头扫了一下几路电源，在3.3V上面就发现了问题所在。
无源探头加3.3V偏置，10mV标尺，测得电源纹波频率500kHz，幅值50mV左右。
SERDES芯片工作在这种电源环境下，也没法独善其身了，出淤泥，不得不染啊~。
剩下的事情就是把3V3的纹波搞定了，此处删去xxx字……收工~~感谢某工提供的问题单板，也希望整个调试过程对您有所帮助。今天的话题是个纯技术的话题，不搞笑……搞科技大多数时候都是枯燥乏味的，等老子有了钱，老子搞……算了，搞咱这行的想有钱？下辈子吧……
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