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- 2022-06-16 发布于辽宁
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YOUR Verilog HDL数字设计与综合（第二版）练习题05解答
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1．利用双输入端的nand门，用Verilog编写自己的双输入端的与门、或门和非门，
把它们分别命名为my_or，my_and和my_not，并通过激励模块验证这些门的
功能。
答：`timescale 1ns/1ns reg a,b;
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