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本发明涉及数据处理技术领域，具体涉及一种内存受限下的数字电路并行静态学习方法及系统，所述方法包括：扫描数字电路，采集数字电路中所有需要学习的学习任务；将学习任务存储到数组中并划分为若干组；创建多个并行的线程，为所有并行的线程分配一个共同的事件队列；获取学习任务组中的学习任务所激发的事件，将事件放入事件队列；所有线程共同对事件队列中的事件进并行静态学习；当所有线程共同完成一组学习任务组之后，确定是否有未完成的学习任务组，若是，则从未完成的学习任务组选取一组学习任务组进行学习；否则，全部线程停止工作
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113919255 A
(43)申请公布日 2022.01.11
(21)申请号 202111064447.1
(22)申请日 2021.09.10
(71)申请人 汕头大学
地址 51
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