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本发明公开了一种用于RISC‑V架构的快速中断系统，属于处理器中断处理技术领域。本发明包括中断控制器和采用哈佛架构的RISC‑V处理器系统，中断控制器用于接收中断源信号并按照CLIC中断机制的向量中断模式向RISC‑V处理器系统的处理器内核发送中断类型码以及中断请求信号，RISC‑V处理器系统中，处理器内核收到来自中断控制器的中断请求信号后，通过硬件并行地进行现场保护和向量表取地址。同时本发明采用了硬件屏蔽电路实现全局中断使能信号的屏蔽，使得处理器在进入中断时不需要关闭全局中断使能，也无需软件重
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114003365 A
(43)申请公布日 2022.02.01
(21)申请号 202111291648.5
(22)申请日 2021.11.01
(71)申请人 浙江大学
地址 31
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