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本发明公开一种半导体器件及其制造方法,涉及半导体制造技术领域,以解决存储接触部和位线结构之间产生的寄生电容较大,从而影响半导体器件工作性能的问题。所述半导体器件包括:具有有源区的半导体衬底;形成在半导体衬底上的位线结构,位线结构包括接触部,以及位于接触部上的位线主体,接触部与有源区的其中一部分接触;以及形成在相邻两个位线结构之间的存储接触部,存储接触部与有源区的另一部分接触;其中,位线主体在接触部上方的部分具有比位线主体的其他部分低的顶部高度。所述半导体器件的制造方法用于制造半导体器件。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114068536 A
(43)申请公布日 2022.02.18
(21)申请号 202010752381.4
(22)申请日 2020.07.30
(71)申请人 中国科学院微电子研究所
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