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一种准循环LDPC编码的硬件实现方法及装置，属于通信技术领域。将校验矩阵H的前n列记为一个矩阵，将矩阵按行分解为M行块；矩阵分解为基矩阵和替换阵。为输出信息比特和校验比特分配存储空间；为M个中间计算结果分配存储空间。对于基矩阵中行重小于其他行的行块，在该行添加一条边，指向校验比特。将M个行块各与信息比特进行矩阵乘法，得到中间结果。利用中间结果迭代计算编码矩阵各行块对应的校验比特，级联结果得到完整校验比特。级联信息比特与校验比特，输出完整LDPC编码结果。本发明通过重新设计LDPC校验矩阵的内容，
(19)国家知识产权局
(12)发明专利
(10)授权公告号 CN 114157307 B
(45)授权公告日 2022.08.16
(21)申请号 202111478103.5 (56)对比文件
(22)申请日 2021.12.06
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