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本发明涉及一种伺服驱动器芯片的浮点数计算方法、装置及系统。其中,伺服驱动器芯片的浮点数计算方法,包括:在伺服驱动器芯片设置浮点数加减运算器,所述浮点数加减运算器的浮点数加减运算包括以下步骤:S1、将两个进行浮点数运算的浮点数的阶码对齐;S2、将阶码对齐后的两个浮点数的尾数的加减运算;S3、将加减运算的结果进行规格化;S4、根据运算结果的阶码的值来判断是否产生溢出,若产生溢出则进行溢出处理。本发明公开的伺服驱动器芯片的浮点数计算方法、装置及系统,使得浮点数的加减运算的计算量大幅度降低,从而降低伺服
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114253507 A
(43)申请公布日 2022.03.29
(21)申请号 202111575574.8
(22)申请日 2021.12.22
(71)申请人 广东技术师范大学
地址
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