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    一实施方式的半导体存储装置具备：第1延迟电路，使第1信号延迟，且延迟时间可变；第1选择电路，基于由第1延迟电路延迟的第1信号，选择第2信号与第3信号中的任一个；第1输出缓冲器，基于由第1选择电路选择的信号来输出第4信号；第1输出垫，将第4信号输出到外部；及计数器，能计数第4信号的输出次数。

    (19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 114303192 A (43)申请公布日 2022.04.08 (21)申请号 201980099797.6 (51)Int.Cl.

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