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在各类ADC中，SARADC是其中很常用的一类，它具有高度数字化易于集成的特性，较低的功耗，但要想在中高精度场合中应用SARADC，就需要优化比较器模块的性能。如果想要保持SARADC的功耗优势而采取动态比较器结构，如何尽可能的降低噪声同时保持速度性能是关键的设计问题。本发明提出了一种低噪声二级动态比较器，通过简单的电路设计降低了比较器的等效输入噪声，在少量的额外功耗上保持了较好的速度性能。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114520650 A
(43)申请公布日 2022.05.20
(21)申请号 202210043089.4
(22)申请日 2022.01.14
(71)申请人 电子科技大学
地址 611731
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