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本发明提供了一种集成电路设计中插入时钟门控的方法,包括以下步骤:1)将目标设计被抽象历程处理转换成以操作为基底的通用网表,所述目标设计,包括,寄存器传输级;2)设定部分时钟门控约束;3)识别所有时序器件并将其转换成相对更通用的时序器件;4)选取时序器件,寻找选定时序器件的反馈回路,制作反馈回路签名,所述反馈回路签名,包括,反馈回路中的所有的实例类型、每个实例的控制信号与每个实例的反馈位置;5)检查当前的时序器件是否存在可能与其他的时序器件共享激源逻辑电路并产生时钟门控群组;6)对时序器件进行分组
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116090371 A
(43)申请公布日 2023.05.09
(21)申请号 202211613425.0
(22)申请日 2022.12.15
(71)申请人 上海华大九天信息科技有限公司
地址
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