用于可缩放预留站的方法、系统和装置.pdfVIP

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2023-05-14 发布于北京
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本公开描述了用于可缩放预留站的方法、系统和装置。在一种实施例中，硬件处理器核心包括：解码器电路，用于将一个或多个指令解码成从数据缓存加载数据的第一微操作，依赖于第一微操作的第二微操作，以及依赖于第二微操作的第三微操作；执行电路，用于执行第一微操作、第二微操作和第三微操作；以及预留站电路，包括加载推测跟踪器电路并且耦合在解码器电路和执行电路之间，加载推测跟踪器电路对于第三微操作的预留站条目，跟踪第一微操作在数据缓存中的进度，以响应于第一微操作对在数据缓存中的数据的错失而为第三微操作生成取消指示，其

(19)国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 114675882 A (43)申请公布日 2022.06.28 (21)申请号 202111193523.9 G06F 9/445 (2018.01) (22)申请日 2021.10.