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一种电路布置,包括设置在片上系统(SoC)(102)上并被配置为接收和存储流式调试包的一个或多个输入缓冲器(312、314,…,316)。一个或多个响应缓冲器(328、330,……,332)也被设置在SoC上。事务控制电路(318)设置在SoC上,并被配置为处理一个或多个输入缓冲器中的每个调试包。该处理包括:解码调试包中的操作代码;以及从调试包中的地址确定多个接口电路中的一个接口电路,以访问SoC上多个子系统中的一个子系统中的存储电路。所述处理还包括根据该操作代码经由接口电路发出访问存储电路的请
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112292670 A
(43)申请公布日 2021.01.29
(21)申请号 201980038059.0 (74)专利代理机构 北京市君合律师事务所
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