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- 2023-05-28 发布于四川
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本发明公开了.一种通用交替采样ADC系统,采用JESD204B串行数据接口作为所述数据接口;采用校准方式对各ADC之间的失调失配及增益失配进行匹配;对于各ADC之间的时钟相位调节时钟管理电路,优化时序失配及带宽失配;采用系统封装技术(SIP)将所述优化后的时钟管理电路与校准后的ADC采集电路整合封装为一颗芯片。本发明解决交替采样ADC系统因为失调失配、增益失配、时序失配和带宽失配四种失配问题造成的设计周期和难度,提高交替采样ADC系统的通用性和抗干扰性。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112383310 A
(43)申请公布日 2021.02.19
(21)申请号 202011328599.3
(22)申请日 2020.11.24
(71)申请人 中国兵器装备集团自动化研究所
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