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- 2023-05-30 发布于四川
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一种处理器[100]，包括分支目标缓冲器(BTB)[110]，所述BTB[110]具有多个条目[111]，其中每个条目对应于被预测为分支指令的相关联的指令指针[101]值。每个BTB条目存储所述分支指令的预测分支目标地址，并且还存储指示与所述预测分支目标地址相关联的指令块中的下一个分支是否被预测为返回指令的信息。响应于所述BTB指示所述下一个分支被预测为返回指令，所述处理器发起对存储所述预测返回指令的返回地址的返回堆栈[115]的访问。通过响应于存储在所述BTB处的所述返回预测而发起对所述返回堆
(19)国家知识产权局
(12)发明专利
(10)授权公告号 CN 112470122 B
(45)授权公告日 2022.05.10
(21)申请号 201980049605.0 马吕斯 ·埃弗斯
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