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实施方式提供一种能够改善良率的半导体存储装置。实施方式的半导体存储装置包括衬底、第1至第3导电体层、第1半导体层、及第1绝缘体层。衬底SUB包括第1区域MR、第2区域PR、及第3区域BR。多个第1导电体层23于第1区域内相互分离地设于衬底的上方。多个第2导电体层25相互分离地设于最上层的第1导电体层的上方。第1半导体层MP贯通第1及第2导电体层而设置。第3导电体层62于第2区域内设于衬底的上方。第1绝缘体层包括在第2区域内设于第3导电体层的上方且比最上层的第1导电体层更靠上层的第1部分59U,及
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112447745 A
(43)申请公布日
2021.03.05
(21)申请号 20201
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