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本发明提供基于FPGA的规则引擎加速执行方法、装置、介质及设备。所述装置包括：规则引擎层，构建于CPU，用于获取待处理的规则数据，从所述规则数据中选择出简单依赖关系的规则数据，并将其送往规则加速核；所述规则加速核，构建于与所述CPU通信连接的FPGA，用于对所述简单依赖关系的规则数据进行计算，并将计算结果送往所述规则引擎层，以供所述规则引擎层予以输出。本发明基于FPGA来实现规则引擎的加速执行，使得规则引擎的并行处理能力获得了极大的提升，具有超高并发能力和超低延时。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112527832 A
(43)申请公布日
2021.03.19
(21)申请号 20191
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