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本发明公开了一种时钟发生器包括插值除法器，该插值除法器包括相位插值器和多模除法器。插值除法器被配置为基于时钟信号、控制码和相位插值器校准信号来生成输出时钟信号。时钟发生器包括校准电路，该校准电路被配置为基于时钟信号、输出时钟信号和相位插值器代码来生成相位插值器校准信号。校准电路包括锁相环，该锁相环被配置为基于参考时间戳信号以及基于时钟信号和输出时钟信号的时间戳信号生成数字相位误差信号。校准电路包括被配置为基于数字相位误差信号来生成相位插值器校准信号的自适应环。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112564698 A
(43)申请公布日 2021.03.26
(21)申请号 202011023485.8
(22)申请日 2020.09.25
(30)优先权数据
16/582,26
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