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本发明公开了一种五轴绝对式编码器解算解算电路系统，包括：FPGA模块，时钟信号转换电路，数据信号转换电路，同步信号输出，ISA位置信号输出及绝对式编码器接口。其特征在于：FPGA模块发送统一的10K时钟信号，其中五路信号经过收发器送入到五个角度编码器，第六路经过收发器后，通过IO口，输出同步信号给用户使用；FPGA模块发送位置信息采集指令到五个角度编码器，五个编码器的位置信息经过5路收发器，五路控制信号分别控制信号转换电路，依次通过一路接收端传送到FPGA模块进行五个编码器的位置解算，并通过位置
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112539771 A
(43)申请公布日 2021.03.23
(21)申请号 201910896413.5
(22)申请日 2019.09.20
(71)申请人 九江精密测试技术研究所
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