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本发明公开一种低时延、幸存路径长度自动调节的维特比译码电路，属于数字通信领域，包括译码控制电路、插值电路、分支度量计算电路、加比选电路和幸存路径回溯电路。译码控制电路根据配置生成译码电路控制信息；插值电路对码率为2/3、3/4的软比特数据进行插值操作，使之恢复成1/2码率的软比特数据；分支度量计算电路在当前节点下计算软比特数据相对4种不同输出所对应的分支度量值；加比选电路进行路径度量的计算、比较与选择，选出幸存路径并将节点信息存入SRAM中；幸存路径回溯电路回溯幸存路径，译出码字。本发明能减小电
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116192155 A
(43)申请公布日 2023.05.30
(21)申请号 202211618272.9
(22)申请日 2022.12.15
(71)申请人 中科芯集成电路有限公司
地址 2
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